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任職要求及職責(zé)描述：
1、負(fù)責(zé)數(shù)?；旌闲酒脑O(shè)計(jì)和驗(yàn)證
2、負(fù)責(zé)數(shù)?；旌霞軜?gòu)、模擬電路版圖設(shè)計(jì)、數(shù)字DSP架構(gòu)設(shè)計(jì)、數(shù)模接口定義等
3、規(guī)劃版圖布局方案并組織進(jìn)行版圖設(shè)計(jì)，并檢查版圖設(shè)計(jì)是否符合要求
4、負(fù)責(zé)數(shù)?；旌闲酒琈PW、測試方案的規(guī)劃，規(guī)劃測試板原理圖和PCB設(shè)計(jì)
5、負(fù)責(zé)數(shù)?；旌闲酒瑴y試，撰寫用戶手冊等文檔
職位要求：
1、碩士以上學(xué)歷，微電子或電子工程等相關(guān)專業(yè)
2、5年及以上數(shù)?；旌想娐吩O(shè)計(jì)經(jīng)驗(yàn)，具備模擬團(tuán)隊(duì)管理經(jīng)驗(yàn)
3、具有 Matlab 和 VerilogA 的行為級建模經(jīng)驗(yàn)
4、熟練運(yùn)用Cadence Virtuoso進(jìn)行模擬/混合信號設(shè)計(jì)以及電磁建模、仿真、DRC、LVS
5、具有高速電路相關(guān)設(shè)計(jì)和測試經(jīng)驗(yàn)
6、清晰的書面和口頭溝通技巧
7、良好的英語能力
8、具有設(shè)計(jì)以下模塊經(jīng)驗(yàn)者優(yōu)先
Ethernet PHY、 Driver、ADC/DAC、BG、PLL、EQ、AGC、BLW、Adaptive Control
薪資：
薪資 股權(quán)激勵，具體面談