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        當(dāng)前位置:首頁> 列表 >職位詳情
        FPGA高級(jí)工程師
        面議 應(yīng)屆畢業(yè)生 學(xué)歷不限
        • 全勤獎(jiǎng)
        • 節(jié)日福利
        • 不加班
        • 周末雙休
        廣州興森快捷電路科技有限公司 2025-06-16 17:56:01 1137人關(guān)注
        職位描述
        該職位還未進(jìn)行加V認(rèn)證,請仔細(xì)了解后再進(jìn)行投遞!
        1、產(chǎn)品的邏輯開發(fā)設(shè)計(jì)與調(diào)試
        2、參與系統(tǒng)需求的分解,邏輯模塊的資源評(píng)估和器件選用的管腳驗(yàn)證
        3、編寫邏輯設(shè)計(jì)的需求分解文檔,邏輯的詳細(xì)設(shè)計(jì)文檔,自測報(bào)告,軟硬件接口文檔等
        4、編寫邏輯設(shè)計(jì)代碼,并搭建仿真平臺(tái)進(jìn)行功能仿真
        5、負(fù)責(zé)項(xiàng)目的單板邏輯模塊的自測和軟硬件聯(lián)調(diào)
        6、項(xiàng)目的邏輯版本管理
        任職資格:
        1.學(xué)歷:通信、電子、自動(dòng)化等相關(guān)專業(yè)本科及以上學(xué)歷。
        2.專業(yè):電子、通信、自動(dòng)化等相關(guān)專業(yè)
        要求:
        1、具有扎實(shí)圖像處理基礎(chǔ)理論,熟悉圖像處理常用算法;
        2、具備較強(qiáng)的數(shù)字信號(hào)處理和數(shù)字電路設(shè)計(jì)相關(guān)知識(shí);
        3、良好的英語閱讀能力;
        4、精通Verilog/VHDL設(shè)計(jì)語言和FPGA設(shè)計(jì)流程;
        5、熟練使用Vivado/Quartus,Modelsim等FPGA開發(fā)工具;
        6、熟悉Xilinx/Altera FPGA常用器件,了解FPGA SOC開發(fā)流程;
        7、熟練使用邏輯分析儀、示波器等工具進(jìn)行調(diào)試和測試;
        8、有視頻處理的項(xiàng)目開發(fā)經(jīng)驗(yàn),能獨(dú)立的完成項(xiàng)目項(xiàng)目邏輯功能模塊周期的開發(fā)工作。
        聯(lián)系方式
        注:聯(lián)系我時(shí),請說是在武清人才網(wǎng)上看到的。
        工作地點(diǎn)
        地址:廣州黃埔區(qū)光譜中路33號(hào)
        求職提示:用人單位發(fā)布虛假招聘信息,或以任何名義向求職者收取財(cái)物(如體檢費(fèi)、置裝費(fèi)、押金、服裝費(fèi)、培訓(xùn)費(fèi)、身份證、畢業(yè)證等),均涉嫌違法,請求職者務(wù)必提高警惕。
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